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《EDA技術(shù)》課程在線作業(yè)2
試卷總分:100 得分:100
第1題,在VHDL的CASE語句中，條件語句中的"="不是操作符號(hào)，其作用相當(dāng)于（ ）。
A、IF
B、THEN
C、AND
D、OR
正確答案:
第2題,CPLD內(nèi)部含有多個(gè)邏輯單元塊，每個(gè)邏輯單元塊相當(dāng)于一個(gè)（ ）。
A、PAL
B、GAL
C、FPGA
D、EPROM
正確答案:
第3題,在VHDL中，( )的數(shù)據(jù)傳輸是立即發(fā)生的，不存在任何延時(shí)的行為。
A、信號(hào)
B、常量
C、數(shù)據(jù)
D、變量
正確答案:
第4題,VHDL程序基本結(jié)構(gòu)包括
A、實(shí)體、子程序、配置
B、實(shí)體、結(jié)構(gòu)體、配置、函數(shù)
C、結(jié)構(gòu)體、狀態(tài)機(jī)、程序包和庫
D、實(shí)體、結(jié)構(gòu)體、程序包和庫
正確答案:
答案來源：（www.）,下例程序執(zhí)行后，X和Y的值分別為 。process(A,B,C)
variable D : std_logic;
beginD := A;X = B+D;D := C;Y = B+D;
end process;
A、B+C和B+A
B、B+A和B+C
C、B+C和B+C
D、B+A和B+A
正確答案:
第6題,下面哪個(gè)說法是錯(cuò)誤的
A、進(jìn)程語句與進(jìn)程語句之間是并行執(zhí)行的，進(jìn)程語句內(nèi)部是順序執(zhí)行的
B、進(jìn)程語句是可以嵌套使用的
C、塊語句與塊語句之間是并行執(zhí)行的，塊語句內(nèi)部也是并行執(zhí)行的
D、塊語句是可以嵌套使用的
正確答案:
第7題,符合1987VHDL標(biāo)準(zhǔn)的標(biāo)識(shí)符是
A、2A
B、A+2
C、A_2
D、22
正確答案:
第8題,EDA設(shè)計(jì)流程包括設(shè)計(jì)準(zhǔn)備、（ ）、設(shè)計(jì)處理和器件編程四個(gè)步驟。
A、總體設(shè)計(jì)
B、設(shè)計(jì)輸入
C、詳細(xì)設(shè)計(jì)
D、設(shè)計(jì)數(shù)據(jù)
正確答案:
第9題,傳統(tǒng)電路設(shè)計(jì)思想是______________。
A、自下而上
B、自外而里
C、自上而下
D、自里而外
正確答案:
答案來源：（www.）,在結(jié)構(gòu)體說明中的幾種結(jié)構(gòu)體功能描述語句為 語句。
A、順序執(zhí)行
B、并行執(zhí)行
C、順序/并行執(zhí)行
D、循環(huán)執(zhí)行
正確答案:
第11題,在VHDL中，45_234_287屬于( )文字。
A、整數(shù)
B、以數(shù)制基數(shù)表示的
C、實(shí)數(shù)
D、物理量
正確答案:
答案來源：（www.）,EDA的設(shè)計(jì)驗(yàn)證包括功能仿真、（ ）和器件測(cè)試三個(gè)過程。
A、形式仿真
B、時(shí)序仿真
C、數(shù)值仿真
D、行為仿真
正確答案:
第13題,Altera公司開發(fā)的開發(fā)軟件為
A、Foundation
B、ispDesignEXPERT
C、MaxplusⅡ
D、ISE
正確答案:
第14題,下面哪個(gè)選項(xiàng)不是信號(hào)和變量的不同特性
A、賦值方式不同
B、定義位置不同
C、賦值行為不同
D、綜合結(jié)果不同
正確答案:
答案來源：（www.）,順序語句中的轉(zhuǎn)向控制語句包括
A、if 語句、 case 語句、return 語句、Exit 語句
B、if 語句、 case 語句、Loop 語句、 Next 語句、 Exit 語句
C、if 語句、 case 語句、Loop 語句、return 語句
D、case 語句、Loop 語句、 Next 語句、null 語句
正確答案:
第16題,變量是一種局部量，變量可在以下哪些位置進(jìn)行定義
A、process、architecture、entity
B、process、function、procedure
C、function、entity、package
D、entity、package、procedure
正確答案:
第17題,不符合進(jìn)程語句啟動(dòng)條件的是
A、if語句
B、wait語句
C、敏感信號(hào)量
D、wait語句或敏感信號(hào)量
正確答案:
第18題,常用的硬件描述語言有
A、VHDL、Verilog、c語言
B、ABEL、c＋＋
C、VHDL、Verilog、ABEL
D、匯編語言、ABEL、VHDL
正確答案:
第19題,如果A、B均為為std_logic_vector的數(shù)據(jù)類型，A的值為"100"，B的值為"011"，則B&A的值為____________。
A、100011
B、011100
C、110011
D、010011
正確答案:
答案來源：（www.）,Xilinx 公司開發(fā)的開發(fā)軟件為
A、ISE
B、ispDesignEXPERT 系列
C、QuartusⅡ
D、MaxplusⅡ
正確答案:
