可做奧鵬院校所有作業(yè),畢業(yè)論文,咨詢(xún)請(qǐng)?zhí)砑観Q:3230981406 微信:aopopenfd777[四川大學(xué)]《數(shù)字電子技術(shù)2390》21春在線(xiàn)作業(yè)2試卷總分:100得分:100第1題,題面如下:A

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[四川大學(xué)]《數(shù)字電子技術(shù)2390》21春在線(xiàn)作業(yè)2
試卷總分:100    得分:100
第1,題面如下:
A、a
B、b
C、c
D、d
正確答案:


第2題,三變量函數(shù)的最小項(xiàng)表示式中不含下列哪項(xiàng)(       )。
A、m2
B、m5
C、m3
D、m7
正確答案:


第3題,如圖所示邏輯電路為(       )。
A、異步二進(jìn)制加法計(jì)數(shù)器
B、同步二進(jìn)制加法計(jì)數(shù)器
C、同步二進(jìn)制減法計(jì)數(shù)器
D、異步二進(jìn)制減法計(jì)數(shù)器
正確答案:


第4題,
A、同步四進(jìn)制計(jì)數(shù)器
B、同步六進(jìn)制計(jì)數(shù)器
C、同步八進(jìn)制計(jì)數(shù)器
D、同步五進(jìn)制計(jì)數(shù)器
正確答案:


答案來(lái)源:(www.),用555定時(shí)器構(gòu)成單穩(wěn)態(tài)觸發(fā)器,其輸出脈寬為()
A、0.7RC
B、1.1RC
C、1.4RC
D、1.8RC
正確答案:


第6題,用兩個(gè)半加器和一個(gè)或門(mén)構(gòu)成一全加器,其正確的設(shè)計(jì)的表達(dá)式為()。
A、
B、
C、
D、
正確答案:


第7題,下列邏輯電路中為時(shí)序邏輯電路的是(   )。
A、變量譯碼器
B、加法器
C、數(shù)碼寄存器
D、數(shù)據(jù)選擇器
正確答案:


第8題,函數(shù)化簡(jiǎn)后的結(jié)果是 (       )。
A、
B、
C、
D、
正確答案:


第9題,
A、8進(jìn)制計(jì)數(shù)器
B、7進(jìn)制計(jì)數(shù)器
C、6進(jìn)制計(jì)數(shù)器
D、5進(jìn)制計(jì)數(shù)器
正確答案:


答案來(lái)源:(www.),題面如下:
A、a
B、b
C、c
D、d
正確答案:


第11題,當(dāng)三態(tài)門(mén)輸出為高阻狀態(tài)時(shí),輸出電阻為(       )。
A、無(wú)窮大(正確答案)
B、約100?
C、無(wú)窮小
D、約10?
正確答案:


答案來(lái)源:(www.),A/D轉(zhuǎn)換器中,轉(zhuǎn)換時(shí)間最短的是(     )。
A、并行比較型ADC
B、逐次比較型ADC
C、雙積分型ADC
D、并行比較型ADC和雙積分型ADC
正確答案:


第13題,下圖電路由JK觸發(fā)器及與非門(mén)構(gòu)成,當(dāng)輸入I=1時(shí),發(fā)現(xiàn)該電路若在K輸入處以置0代替Qn,則電路性能(     )。
A、會(huì)改變
B、不會(huì)改變
C、不能確定
D、有時(shí)改變,有時(shí)不改變。
正確答案:


第14題,函數(shù)化簡(jiǎn)后的結(jié)果是 (       )。
A、B+D
B、0
C、1
D、A+B
正確答案:


答案來(lái)源:(www.),題面如下:
A、a
B、b
C、c
D、d
正確答案:


第16題,一片容量為1k×4的存儲(chǔ)器,其存儲(chǔ)單元有(       )個(gè)。
A、4096
B、1024
C、2048
D、1M
正確答案:


第17題,8位D/A轉(zhuǎn)換器,滿(mǎn)度輸出電壓25.5V,當(dāng)輸入數(shù)字量為11101101時(shí),輸出電壓是(       )。
A、23.7V
B、25.5V
C、12.8V
D、2.37V
正確答案:


第18題,下列電路中不屬于時(shí)序邏輯電路的是(       ) 。
A、只讀存儲(chǔ)器(ROM)
B、計(jì)數(shù)器
C、寄存器
D、分頻器
正確答案:


第19題,
A、
B、
C、
D、
正確答案:


答案來(lái)源:(www.),在下列(       )的輸入情況下,與非運(yùn)算的結(jié)果等于邏輯0。
A、全部輸入為1
B、任意輸入為0
C、僅有一個(gè)輸入為0
D、全部輸入為0
正確答案:


第21題,施密特觸發(fā)器的特點(diǎn)是電路具有兩個(gè)穩(wěn)態(tài)且每個(gè)穩(wěn)態(tài)需要相應(yīng)的輸入條件維持。對(duì)嗎?
T、對(duì)
F、錯(cuò)
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第22題,數(shù)值比較器在比較兩個(gè)多位數(shù)的大小時(shí),是按照從低位到高位的順序逐位比較的。對(duì)嗎?
T、對(duì)
F、錯(cuò)
正確答案:F


第23題,普通編碼器和優(yōu)先編碼器在某一時(shí)刻都只能輸入一個(gè)有效的編碼信號(hào)。對(duì)嗎?
T、對(duì)
F、錯(cuò)
正確答案:F


第24題,n變量的邏輯函數(shù)其全部最小項(xiàng)有n個(gè)。
A、錯(cuò)誤
B、正確
正確答案:


答案來(lái)源:(www.),組合邏輯電路沒(méi)有記憶功能。
A、錯(cuò)誤
B、正確
正確答案:


第26題,四位二進(jìn)制數(shù)碼有16種組合,其中任意10種組合均可以對(duì)應(yīng)表示十進(jìn)制數(shù)中的十個(gè)數(shù)碼。
A、錯(cuò)誤
B、正確
正確答案:


第27題,要改變觸發(fā)器的狀態(tài),必須有CP脈沖的配合。
A、錯(cuò)誤
B、正確
正確答案:


第28題,TTL邏輯門(mén)電路和CMOS集成門(mén)電路不能直接混合使用。對(duì)嗎?
T、對(duì)
F、錯(cuò)
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第29題,
A、錯(cuò)誤
B、正確
正確答案:


答案來(lái)源:(www.),二進(jìn)制的算術(shù)運(yùn)算通常是轉(zhuǎn)換成加法運(yùn)算來(lái)完成的。對(duì)嗎?
T、對(duì)
F、錯(cuò)
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第31題,D觸發(fā)器的特性方程為Qn+1=D,與Qn無(wú)關(guān),所以它沒(méi)有記憶功能。
A、錯(cuò)誤
B、正確
正確答案:


第32題,A/D轉(zhuǎn)換器的分辯率越高,轉(zhuǎn)換精度也越高。對(duì)嗎?
T、對(duì)
F、錯(cuò)
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第33題,譯碼器是一種多路輸入、多路輸出的邏輯部件。
A、錯(cuò)誤
B、正確
正確答案:


第34題,移位寄存器不僅可以寄存代碼,而且可以實(shí)現(xiàn)數(shù)據(jù)的串-并行轉(zhuǎn)換和處理。對(duì)嗎?
T、對(duì)
F、錯(cuò)
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第35題,在VerilogHDL語(yǔ)言中,行為級(jí)描述方式的關(guān)鍵詞是initial或always,always是無(wú)限循環(huán)語(yǔ)句。對(duì)嗎?
T、對(duì)
F、錯(cuò)
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